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        的LatticeXP系列數據手冊
        DS1001 05.1版本, 2007年11月
        的LatticeXP系列數據手冊
        介紹
        2007年7月
        數據表DS1001
        特點
        非易失性,在網絡奈特雷偵察網絡可配置
        ?即時通 - 權力在微秒
        ?無需外部CON組fi guration內存
        ?卓越的設計安全性,無比特流
        截距
        以毫秒為單位?偵察網絡gure基于SRAM的邏輯
        ? SRAM和非易失性存儲器的可編程
        通過系統CON組fi guration和JTAG端口
        靈活的I / O緩沖器
        ?可編程的sysIO ?緩沖器支持寬
        一系列的接口:
        ?
        LVCMOS 3.3 / 2.5 / 1.8 / 1.5 / 1.2
        ?
        LVTTL
        - SSTL我18級
        ?
        3/2 SSTL I類, II
        - HSTL15 I級, III
        ?
        18 HSTL I類, II , III
        ?
        PCI
        ?
        LVDS ,總線LVDS , LVPECL , RSDS
        睡眠模式
        ?允許高達1000倍的靜態電流降低
        的TransFR ?偵察組fi guration ( TFR )
        ?在 - 場科幻邏輯更新,同時系統運行
        專用DDR內存支持
        ?實現了接口高達DDR333 ( 166MHz的)
        廣泛的密度和封裝選項
        ? 3.1K到19.7K LUT4s
        ? 62至340的I / O
        ?密度遷移支持
        SYSCLOCK ?鎖相環
        ?每個設備最多可以4個模擬鎖相環
        ?時鐘乘法,除法和相移
        系統級支持
        ? IEEE標準1149.1邊界掃描,再加上
        ispTRACY ?內部邏輯分析儀功能
        ?板載振蕩器CON組fi guration
        ?器件采用3.3V , 2.5V , 1.8V或1.2V操作
        電源
        嵌入式和分布式存儲器
        ? 54 Kb至396千位的sysMEM ?嵌入式
        塊RAM
        ?高達79 Kb的分布式RAM
        ?靈活的內存資源:
        ?
        分布式塊存儲器
        表1-1 。的LatticeXP系列選型指南
        設備
        PFU / PFF行
        PFU / PFF列
        PFU / PFF (總)
        的LUT ( K)
        分布式RAM (千位)
        EBR SRAM (千位)
        EBR塊SRAM
        V
        CC
        電壓
        鎖相環
        馬克斯。 I / O
        封裝和I / O組合:
        100引腳TQFP封裝( 14 ×14 MM)
        144引腳TQFP ( 20 ×20 MM)
        208引腳PQFP ( 28 ×28 MM)
        256球引腳fpBGA ( 17× 17mm)的
        388球引腳fpBGA ( 23 ×23 MM)
        484球引腳fpBGA ( 23 ×23 MM)
        62
        100
        136
        100
        142
        188
        LFXP3
        16
        24
        384
        3
        12
        54
        6
        1.2/1.8/2.5/3.3V
        2
        136
        LFXP6
        24
        30
        720
        6
        23
        72
        8
        1.2/1.8/2.5/3.3V
        2
        188
        LFXP10
        32
        38
        1216
        10
        39
        216
        24
        1.2/1.8/2.5/3.3V
        4
        244
        LFXP15
        40
        48
        1932
        15
        61
        324
        36
        1.2/1.8/2.5/3.3V
        4
        300
        LFXP20
        44
        56
        2464
        20
        79
        396
        44
        1.2/1.8/2.5/3.3V
        4
        340
        188
        244
        188
        268
        300
        188
        268
        340
        ?2005萊迪思半導體公司萊迪思的所有商標,注冊商標,專利和網站上列出的www.latticesemi.com/legal 。所有其他品牌
        或產品名稱均為其各自所有者的注冊商標。本文中的說明和信息,如有變更,恕不另行通知。
        www.latticesemi.com
        1-1
        DS1001 Introduction_01.5a 2007年7月6日下午3時01分
        萊迪思半導體公司
        介紹
        的LatticeXP系列數據手冊
        介紹
        FPGA器件的LatticeXP家族結合的邏輯門,在一個嵌入式存儲器和高性能I / O的
        單一架構既非易失性和網絡奈特雷偵察網絡可配置,支持經濟高效的系統設計。
        中的LatticeXP家庭中使用的可再編程的非易失性技術是下一代ispXP ?技
        術。有了這項技術,昂貴的外部CON組fi guration回憶不要求和設計固定
        從回讀未授權。此外,即時開機功能可以很容易地接口在許多應用中。
        ispLEVER的
        ?
        萊迪思設計工具允許大型復雜的設計是使用Lat-英法fi ciently實施
        ticeXP系列FPGA器件。適用于流行的邏輯綜合工具的LatticeXP合成庫的支持。
        ispLEVER的工具使用綜合工具的輸出以及從FL OOR規劃工具來放置約束
        與路線設計中的LatticeXP設備。 ispLEVER的工具提取從路由和背景的時機
        詮釋它融入到設計中的時序VERI網絡陽離子。
        萊迪思提供了許多預先設計的IP (知識產權)的ispLeverCORE ?模塊的的LatticeXP家庭。
        通過使用這些IP地址的標準化模塊,設計師可以自由地專注于自己的設計的獨特方面,
        提高他們的生產力。
        1-2
        的LatticeXP系列數據手冊
        架構
        2007年7月
        數據表DS1001
        體系結構概述
        該的LatticeXP架構包含的邏輯塊陣列由可編程I / O單元( PIC )包圍。之間
        邏輯塊的行之間spersed是行的sysMEM嵌入式RAM塊( EBR) ,如圖2-
        1.
        對PFU陣列的左側和右側,有非易失性存儲器塊。在CON組fi guration模式,這種非
        易失性存儲器是通過IEEE 1149.1 TAP端口或SYSCONFIG ?外設端口編程。上電時,
        在CON組fi guration數據從非易失性存儲器塊的CON組fi guration SRAM傳輸。與此
        技術,昂貴的外部CON組fi guration回憶不要求和設計從unautho-擔保
        授權的讀回。這從非易失性存儲器中,通過廣泛的總線的數據傳送到CON組fi guration的SRAM中發生
        微秒,提供“即時接通”功能,可以讓方便地實現多種應用。
        有兩種類型的邏輯塊,所述可編程功能單元( PFU)和可編程功能單元
        而RAM / ROM ( PFF ) 。該PFU包含構建塊的邏輯,算術,RAM,ROM和注冊功能
        系統蒸發散。該PFF塊包含邏輯,算術和ROM功能的積木。這兩個PFU和PFF塊
        對于靈活性進行了優化,使復雜的設計可以快速實施,英法fi ciently 。邏輯模塊
        排列成二維陣列。只有一種類型的塊時,每行中使用。在PFU塊的輸出用
        側行。所述芯的其余部分由行PFF塊的散布有排PFU塊組成。對于每一個
        三行PFF塊有一排PFU塊。
        每個PIC塊包括2個PIO (PIO對)與它們各自的sysIO接口。在左邊的PIO對和
        該設備的右邊緣可以CON組fi gured的LVDS發送/接收對。的sysMEM EBRS是大型專用快
        存儲器塊。他們可以是CON連接gured為RAM或ROM 。
        該PFU , PFF ,PIC和EBR塊排列成一個二維網格的行和列中所示
        圖2-1 。這些塊被以許多垂直和水平的路由信道資源相連。的地方,
        路由軟件工具自動分配這些布線資源。
        在含有的sysMEM塊的行的端部是在SYSCLOCK鎖相環( PLL)的塊。這些
        鎖相環有乘法,除法和相移功能;它們被用于管理的相位關系
        時鐘。該的LatticeXP架構提供高達每臺設備4個PLL 。
        在家庭中的每個設備都有一個JTAG端口與內部邏輯分析儀( ispTRACY )的能力。該SYSCONFIG
        端口允許串行或并行設備CON組fi guration 。該器件的LatticeXP可以從操作
        3.3V , 2.5V , 1.8V和1.2V電源,可輕松集成到整個系統中。
        ?2007萊迪思半導體公司萊迪思的所有商標,注冊商標,專利和網站上列出的www.latticesemi.com/legal 。所有其他品牌
        或產品名稱均為其各自所有者的注冊商標。本文中的說明和信息,如有變更,恕不另行通知。
        www.latticesemi.com
        2-1
        DS1001
        Architecture_02.0 2007年7月6日下午3時03分
        萊迪思半導體公司
        圖2-1 。的LatticeXP頂級框圖
        可編程I / O單元
        (PIC )包括的sysIO
        接口
        架構
        的LatticeXP系列數據手冊
        的sysMEM嵌入式
        RAM塊( EBR )
        非易失性存儲器
        JTAG端口
        SYSCONFIG編程
        端口(包括專用
        和兩用引腳)
        PFF ( PFU不
        內存)
        SYSCLOCK PLL
        可編程
        功能單元( PFU )
        PFU和PFF塊
        中的LatticeXP設備的核心由PFU和PFF塊。 PFU就能可以被編程以執行
        邏輯,算術,分布式RAM和分布式ROM功能。 PFF塊可以被編程以執行
        邏輯,算術和ROM功能。除非有必要,該數據表的其余部分將使用術語
        PFU指既PFU和PFF塊。
        每個PFU塊由四個相互連接的片,編號為0-3 ,如圖2-2所示。所有的內部連接
        系統蒸發散和從PFU塊是從路由。有53個輸入和25與每個PFU塊相關聯的輸出。
        圖2-2 。 PFU圖
        路由
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        LUT4 &
        攜帶
        片0
        片1
        片2
        片3
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        D
        FF/
        LATCH
        To
        路由
        2-2
        查看更多LFXP15C-4F388CPDF信息
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          聯系人:張先生/謝先生
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        LFXP15C-4F388C
        Lattice
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